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Medientyp: E-Artikel Titel: Reprogrammable Redundancy for SRAM-Based Cache $V_{\min }$ Reduction in a 28-nm RISC-V Processor Beteiligte: Zimmer, Brian; Chiu, Pi-Feng; Nikolic, Borivoje; Asanovic, Krste Erschienen: Institute of Electrical and Electronics Engineers (IEEE), 2017 Erschienen in: IEEE Journal of Solid-State Circuits Sprache: Nicht zu entscheiden DOI: 10.1109/jssc.2017.2715798 ISSN: 0018-9200; 1558-173X Schlagwörter: Electrical and Electronic Engineering Entstehung: Anmerkungen: